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一种基于VHDL语言的数字频率计设计

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摘要介绍一种在FPGA中运用VHDL语言实现数字频率计的方法。该频率计其频率测量范围为0Hz～100MHz，测量结果用8只数码管显示。其设计方法与传统的设计方法相比，具有外围电路简单，程序修改灵活和调试容易等特点。

DOI rdxx9w35dl/1012997

作者王刚

机构地区不详

出处《内江职业技术学院学报》 2010年4期

关键词 FPGA VHDL~频率计

分类 [文化科学][教育学]

出版日期 2010年04月14日（中国期刊网平台首次上网日期，不代表论文的发表时间）

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来源期刊

内江职业技术学院学报

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