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DVB-T接收端采样钟同步的FPGA实现

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摘要本文研究了数字电视地面广播(DVB-T)系统中的采样同步算法,利用符号间插入的导频点估计采样时钟偏差,利用凯塞窗函数插值滤波器进行数据的纠正,设计基于FPGA(现场可编程门阵列)实现,经仿真验证可完全达到DVB-T系统的设计要求.

DOI lg4ql9zj8k/6248

作者范文婧

机构地区不详

出处《中国集成电路》 2006年6期

关键词接收端 DVB-T 插值滤波器导频同步算法子信道

分类 [电子电信][微电子学与固体电子学]

出版日期 2006年06月16日（中国期刊网平台首次上网日期，不代表论文的发表时间）

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来源期刊

中国集成电路

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